Verification by Error Modeling: Using Testing Techniques in Hardware Verification - Frontiers in Electronic Testing - Katarzyna Radecka - Libros - Springer-Verlag New York Inc. - 9781402076527 - 30 de noviembre de 2003
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Verification by Error Modeling: Using Testing Techniques in Hardware Verification - Frontiers in Electronic Testing 2003 edition

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216 pages, biography

Medios de comunicación Libros     Hardcover Book   (Libro con lomo y cubierta duros)
Publicado 30 de noviembre de 2003
ISBN13 9781402076527
Editores Springer-Verlag New York Inc.
Páginas 216
Dimensiones 155 × 235 × 14 mm   ·   548 g
Lengua Inglés  

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